机译:使用隔行读取扫描算法的基于二维整数提升的DWT的内存高效VLSI架构
机译:高效存储器的模块化VLSI架构,用于多级提升2-D DWT的高吞吐量和低延迟实现
机译:用于(9,7)小波滤波器的高速,低功耗2-D DWT的高效VLSI架构和FPGA实现
机译:多提升方案:基于线的2-D DWT的内存高效的VLSI实现
机译:提升方案DWT的VLSI设计优化。
机译:多宿主物联网(IoT)设备的内存高效传输方案
机译:基于行的二维离散小波变换VLsI实现的片上存储器优化方案
机译:用于视频应用的高速时间递归二维DCT / IDCT处理器的VLsI设计。